Страница 1 из 1

Как заставить задействовать вход ENA регистра в VHDL/Verilog

Добавлено: Ср дек 11, 2024 12:53:04
imsushka
если использовать

Код: Выделить всё

PROCESS(CLK, RAMStep7)
BEGIN
  IF ( SCRBLANK = '0' ) THEN
    DOTBLANK <= '0';
  ELSIF (RISING_EDGE(CLK)) THEN
    IF ( RAMStep7 = '1' ) THEN
      DOTBLANK <= '1';
    END IF;
  END IF;
END PROCESS;
квартус использует мультиплексор

а хотелось бы что б RAMStep шел на вход ENA. типа для уменьшения количества ЛУТов